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Virtex-6 FPGA Data Sheet: DC and Switching Characteristics
Table 69: Global Clock Input Setup and Hold With MMCM
Symbol
Description
Device
-3
Speed Grade
-2 -1
-1L
Units
Input Setup and Hold Time Relative to Global Clock Input Signal for LVCMOS25 Standard. (1)
T PSMMCMGC /
T PHMMCMGC
No Delay Global Clock Input and IFF (2)
with MMCM
XC6VLX75T
XC6VLX130T
1.45/
–0.18
1.53/
1.57/
–0.18
1.65/
1.72/
–0.18
1.81/
1.78/
–0.08
1.87/
ns
ns
–0.18
–0.18
–0.18
–0.07
XC6VLX195T
XC6VLX240T
XC6VLX365T
XC6VLX550T
1.54/
–0.17
1.54/
–0.17
1.55/
–0.18
N/A
1.66/
–0.17
1.66/
–0.17
1.67/
–0.18
1.84/
1.82/
–0.17
1.82/
–0.17
1.83/
–0.18
2.02/
1.87/
–0.08
1.87/
–0.08
1.87/
–0.07
2.06/
ns
ns
ns
ns
–0.17
–0.17
–0.06
XC6VLX760
N/A
2.26/
2.49/
2.06/
ns
–0.13
–0.13
–0.03
XC6VSX315T
XC6VSX475T
1.56/
–0.18
N/A
1.68/
–0.18
1.85/
1.84/
–0.18
2.03/
1.89/
–0.08
2.07/
ns
ns
–0.23
–0.23
–0.13
XC6VHX250T
1.52/
1.64/
1.80/
N/A
ns
–0.17
–0.17
–0.17
XC6VHX255T
1.52/
1.64/
1.85/
N/A
ns
–0.12
–0.12
–0.12
XC6VHX380T
1.68/
1.81/
1.99/
N/A
ns
–0.16
–0.16
–0.16
XC6VHX565T
N/A
1.81/
1.99/
N/A
ns
–0.01
–0.01
XQ6VLX130T
N/A
1.65/
1.81/
1.87/
ns
–0.18
–0.18
–0.07
XQ6VLX240T
N/A
1.66/
1.82/
1.87/
ns
–0.17
–0.17
–0.08
XQ6VLX550T
N/A
N/A
2.02/
2.06/
ns
–0.17
–0.06
XQ6VSX315T
N/A
1.68/
1.84/
1.89/
ns
–0.18
–0.18
–0.08
XQ6VSX475T
N/A
N/A
2.03/
2.07/
ns
Notes:
–0.23
–0.13
1.
2.
3.
Setup and Hold times are measured over worst case conditions (process, voltage, temperature). Setup time is measured relative to the
Global Clock input signal using the slowest process, highest temperature, and lowest voltage. Hold time is measured relative to the Global
Clock input signal using the fastest process, lowest temperature, and highest voltage.
IFF = Input Flip-Flop or Latch
Use IBIS to determine any duty-cycle distortion incurred using various standards.
DS152 (v3.6) March 18, 2014
Product Specification
www.xilinx.com
58
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